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Design of all-digital PLL using adaptive loop gain controller : 적응 루프 이득 조절기를 이용한 디지털 위상 동기화 루프의 설계
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- Authors
- Advisor
- 정덕균
- Major
- 전기. 컴퓨터공학부
- Issue Date
- 2011-02
- Publisher
- 서울대학교 대학원
- Keywords
- 적응 이득 조절 (ALGC) ; 디지털 위상 동기화 루프 (ADPLL) ; 뱅뱅 위상-주파수 검출기 (BBPFD) ; 가위치법 ; 부분 주파수 분할기 ; adaptive loop gain control ; all-digital phase locked loop (ADPLL) ; bang-bang phase and frequency detector (BBPFD) ; false position method ; fractional frequency divider
- Description
- 학위논문 (박사)-- 서울대학교 대학원 : 전기. 컴퓨터공학부, 2011.2. 정덕균.
- Language
- eng
- URI
- https://hdl.handle.net/10371/159053
http://dcollection.snu.ac.kr:80/jsp/common/DcLoOrgPer.jsp?sItemId=000000029038
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