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Issue Date	Title / Author(s) / Citation	File
2003	發達性 읽기 障碍의 타이밍 調節에 關한 硏究 신성웅	link
2009	상위단계 합성에서의 타이밍 최적화를 위한 버퍼 삽입 활용 박상도	link
2017-03	Clock buffer polarity assignment under useful skew constraints Joo, Deokjin; Kim, Taewhan Integration, the VLSI Journal, Vol.57, pp.52-61	DOI