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Design of a multigigabit/s all-digital clock and data recovery circuit with adaptive proportional gain control : 적응적으로 비례이득을 조절하는 광대역 클럭 및 데이터 복원 회로의 올 디지탈 방식 설계
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- Authors
- Advisor
- 정덕균
- Major
- 전기. 컴퓨터공학부
- Issue Date
- 2011-02
- Publisher
- 서울대학교 대학원
- Keywords
- 올디지털 클럭 및 데이터 복원기 ; 클럭 및 데이터 복원기 ; 뱅뱅 위상 검출기 ; 지터 규격 ; 디지털 제어 발진기 ; 주파수 추적 ; all-digital clock and data recovery ; clock and data recovery ; bang-bang phase detector ; jitter specification ; digitally-controlled oscillator ; frequency acquisition
- Description
- 학위논문 (박사)-- 서울대학교 대학원 : 전기. 컴퓨터공학부, 2011.2. 정덕균.
- Language
- eng
- URI
- https://hdl.handle.net/10371/158991
http://dcollection.snu.ac.kr:80/jsp/common/DcLoOrgPer.jsp?sItemId=000000029029
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