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VHDL을 이용한 고정 소수점 디지탈 신호처리 알고리듬 개발 소프트웨어
VHDL Based Fixed - point Digital Signal Processing Algorithm Development Software

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Authors
금기일; 성원용
Issue Date
1994-11
Publisher
대한전자공학회 = The Institute of Electronics Engineers of Korea
Citation
전자공학회논문지, 제32권 A편, 제11호, 1579-1589쪽, 1994년 11월
Abstract
고정소수점 디지탈 신호처리 알고리듬의 설계 환경이 VHDL(VHSIC Hardware Description Language)을 기반으로 개발되었다. 본 설계 환경에서는 디지탈 신호처리 알고리듬을 블럭 다이아그램으로 표현한 뒤, 부동소수점 VHDL 프로그램으로 변환한 후 모의실험을 하여서 알고리듬을 검증한다. 다음에, 부동소수점 알고리듬은 적절한 소수점의 위치와 단어길이를 가지는 고정소수점 VHDL 프로그램으로 자동 변환된다. 이때, 소수점의 위치와 단어 길이는 신호처리 시스템의 설계 사양에서 주어진 성능을 만족하게 하면서 최소의 하드웨어를 사용하도록 결정된다. 부동소수점 알고리듬의 고정소수점 변환을 빠르게 하기 위해, 같은 단어길이를 가지게 될 신호들을 묶는(group) 방법과 설계 공간을 빠르게 탐색하기 위한 방법들이 연구되었다. 변환된 고정소수점 VHDL 프로그램은 상용화된 VHDL 합성기를 사용하여 바로 ASIC등의 하드웨어로 구현할 수 있다. 따라서, 본 설계 환경은 신호처리 알고리듬의 개발부터 고정소수점 구현까지의 작업을 일관되게 처리할 수 있게 해 준다. ; Software for the development of fixed-point digital signal processing algorithms is developed based on VHDL(VHSIC Hardware Description Language). At this developed CAD software, a floating-point VHDL program for the simulation of a digital signal processing algorithm is obtained from the signal flow graph. Then, the floating-point program is automatically converted to a fixed-point version based on the system level performance measure such as SQNR(Signal to Quantization Noise Ratio) and the cost model of the hardware components employed. In this step, methods for reducing the search space are studied to minimize the design time. The fixed-point VHDL program can be implemented in ASIC’s by using commercially available logic synthesizers. Therefore, this software can provide a seamless design environment from the development of floating-point digital signal processing algorithms to the fixed-point implementation of them.
Language
Korean
URI
http://uci.or.kr/G300-jX398917.v31n11p1579

http://hdl.handle.net/10371/6225
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